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NOIL1SM0300A
RESET_N
SPI
Simultanious
min 12 clk
periods
INT_TIME_1
INT_TIME_2
INT_TIME_3
RESET
(internal)
DS RESET
(internal)
TS RESET
(internal)
PIXEL SAMPLE
(internal)
FOT
Total Integration Time
FOT
min 12 clk
periods
DS Integration Time
TS Integration
Time
Figure 19. Integration Timing in Slave Mode
Readout Timing
The sensor is readout row by row. The LINE_VALID
signal shows when valid data of a row is at the outputs.
FRAME_VALID shows which LINE_VALIDs are valid.
LINE_VALIDs when FRAME_VALID is low, must be
discarded. Figure 20 and Figure 21 illustrate this.
NOTE: The FRAME_VALID signal automatically goes
low after 480 LINE_VALID pulses in
mastermode.
12.5ns
CLK
DATA
<9:0>
Invalid
Valid
Valid
Valid
Valid
Invalid
?Invalid
Valid
Valid
LINE_VALID
Figure 20. LINE_VALID Timing
FRAME_VALID
LINE_VALID
Figure 21. FRAME_VALID Timing
http://onsemi.com
20
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